Design And Reuse 新闻简报
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2019年11月19日
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ARC VPX处理器:为以数据为中心的世界而设计的下一代DSP架构
Synopsys
• 对ASIL B和ASIL D安全等级的支持简化了汽车SoC的ISO 26262认证
• 多个向量浮点流水线每个时钟周期最多可启用512个FLOP
• 针对线性代数和复数算数运算的硬件加速可加速计算密集型算法
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GUC GUC HBM & D2D (Die-to-Die)
完整设计服务内容
• 服务范围: IP设计, 子系统搭建, 中介层(interposer)设计, PI/SI/Thermal
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• 适用于处理器,数据中心和边缘设备
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DesignWare CXL Controller IP with AMBA Bridge
• Supports all features and performance requirements in the CXL 1.0 and 1.1 Specifications
• Supports all required features of the PCI Express 5.0 (32 GT/s), 4.0 (16 GT/s), 3.1 (8 GT/s) and PIPE (32-bit) specifications

Hot at IP SoC 2019 - Shanghai


Allegro DVT
Yujing Wei, VP of Business Development


Chengdu Analog Circuit Technology Inc. (Actt)
Sam Shang, Customer technical support director


SiFive, Inc.
Jay Zhou, Sales Director


VeriSilicon Microelectronics (Shanghai) Co., Ltd.
Jensen Zhang, Vice President, Video Product


Cadence Design Systems, Inc.
Jeffrey Xu, Senior Business Development Manager


Brite Semiconductor
Timothy Zhao, TSM/PM Director


Andes Technology Corporation
Frankwell Lin, President


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