Design And Reuse 新闻简报
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2021年10月12日

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真正经硅验证的 DDR 4/3 Hard PHY
True Circuits • 支持可选控制器的多协议 PHY
• 自动调整时间,优化性能
• 提供带有 I/O 的硬宏交付,实现精确客户平面图
• 实现简易关闭时序、集成和测试

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智能时钟网络为现代AI SoC 提升吞吐率,延迟以及能效
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DesignWare 400G/800G Ethernet PCS IP
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他们在 IP SoC 21 China 上说的话


高速接口IP的前景与技术
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芯动科技——国产一站式高速接口IP及高性能计算芯片定制解决方案
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数字信号处理如何實現224Gbps串行器技朮
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PUFiot和RISC-V如何實現安全的SoC
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基于Codasip A70X带缓存一致性的对称多核处理器
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