Design And Reuse 新闻简报
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2022年6月14日

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Cadence设计IP助力客户完成复杂芯片设计
Cadence
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  • Cadence PCIe IP Overview(PCIe 5.0/6.0 Solutions)
  • Cadence High-Speed SerDes IP and Ethernet Integrated Solution
2022.6.16 AM10:00-11:30
Cadence在线研讨会重磅来袭,立即报名 >>

铸造与技术新闻
设计平台
本周合作设计伙伴

创意电子 HBM3 CoWoS 平台通过流片验证
GUC
  • 将于台积电北美 Symposium 现场展示 [booth: 316]
  • 7.2G HBM3 Controller 与 PHY
  • GLink-2.5D D2D 与 112G SerDes 高速接口
  • 支持台积电最先进 CoWoS-S 与 CoWoS-R 封装技术
  • 支持三星与海力士 HBM3
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关于互连
Products
Alphawave 25-112Gbps Short-Reach PHY

模拟 IP
高集成性多协议控制器OmegaCORE 1.6T
  • 多通道,多费率; 支持1GE到800GE,带宽高达1.6Tbps
  • 完全通道化的集成以太网/FiberChannel/FlexO 解决方案
  • 超低延迟、超小面积及超低功耗
了解更多 >>
AlphaWave IP

处理器新闻
RISC-V
片内环境监测 IP

嵌入式片内环境监测为硅生命周期管理平台的组成部分,可实现从硅到系统可行性监测
Synopsys • 拥有功能丰富的监控子系统,增强芯片性能、可靠性及可预测性
• 实时芯片监测,提供整个硅生命周期内的优化分析
• 适用于 HPC、数据中心、人工智能、汽车及消费类应用的可配置解决方案

图像及视觉
物联网新闻
关于安全
汽车电子新闻
人工智能新闻
合作企业商业新闻
商业新闻

Automotive-Compliant Synopsys Controller IP for PCIe 5.0
• Supports all required features of the PCI Express 5.0 (32 GT/s), 4.0 (16 GT/s)...
• Production-proven datapath support for 32b, 64b, 128b, 256b and 512b implementations

IP SoC 21 China 回顾


芯启源USB 接口IP:优异的性能和良好的兼容
裘烨敏, 销售总监, Corigine Inc.


应用在数据中心、5G 和 AI 的 1-112G/64bps PAM4 多协议 SerDes IP
陈继强, Founder & CEO, eTopus Technology


芯原FLEXA支持低延时、低功耗DDR-less应用
妙维, 多媒体SoC平台高级首席工程师, 芯原股份


利用 PCI Express 5.0 和 6.0 推动超大规模设计极限:将 PAM4 引入 PCIe
Tony Chen, Cadence公司设计 IP 市场总监, Cadence Design Systems, Inc.


高性能、低功耗、高可靠性DDR接口设计与实现
刘好朋, 技术支持总监, 芯耀辉科技有限公司


高速接口IP的前景与技术
饶青, 灿芯半导体(上海)股份有限公司


适用于数据中心及HPC应用中所有AI SoC 的D2D IP方案
Alex Chen, 高级销售总监, OpenFive

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