Design And Reuse 新闻简报
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2022年6月21日

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欢迎阅读2022年6月21日的D&R SoC新闻快讯
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本周合作设计伙伴

创意电子宣布加入UCIe成为贡献者成员
GUC
  • GLink 系列是针对 TSMC CoWoS 和 InFO 最优化的 die to die 连接解决方​​案,已被 AI / HPC / DC 客户采用
  • GLink 支持大部分 UCIe 1.0 数字和模拟功能
  • 第一个 N5 GUC UCIe 将于 1H23 流片
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代工厂新闻
为您的硅方案提供高质量 IP Softnautics
USB 3.2 - 主机、设备、双角色设备及重定时器控制器
AES - 支持128 和 256 位
SHA-1/2/3 加密核心
Reed-Solomon FEC 编解码器 - 基于 IEEE 802.3bj
擦除编解码器 - 数据安全

设计平台
关于互连
在线网络研讨会
解决嵌入式开发挑战 Perforce
了解以 IP 为中心的方案如何为您助力:
• 创建可重复使用并可预先验证的 IP 模块及可兼容、经验证软件。
• 用现有资源计划下一个颗芯片。
• 实现以 IP 为中心的 BoM, 统一团队资源。

时间:太平洋夏令时间 6 月 29 日上午 10:00
美国东部时间下午 1:00


RISC-V
关于安全
业界支持PCIe 6.0规范和CXL 2.0 协议的领先验证解决方案
Synopsys
  • 经过硅验证的PHY IP、控制器 IP 及 VIP
  • 结合数据加密(IDE) 支持 Type 1/2/3 设备
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视频新闻
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• 满足轻量状态机到功能强大的安全协处理器内核需求
• 支持广泛加密标准
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商业新闻

Synopsys PHY IP for PCIe 5.0 on TSMC N7
• Physical Coding Sublayer (PCS) block with PIPE interface
• Supports PCIe 5.0, 4.0, 3.1, 2.1, 1.1 encoding, backchannel initialization

IP SoC 21 China 回顾


芯动科技——国产一站式高速接口IP及高性能计算芯片定制解决方案
高专, CTO, Innosilicon Technology Ltd


数字信号处理如何實現224Gbps串行器技朮
Tony Pialis, CEO & President, Alphawave IP, Inc.


PUFiot和RISC-V如何實現安全的SoC
楊青松, Executive VP, PUFsecurity


基于Codasip A70X带缓存一致性的对称多核处理器
Tina Xiang, Codasip GmbH


ARM Mali GPU为实时光线追踪加速
Steven Brightfield, Chief Marketing Officer, Siliconarts, Inc.


面向广泛市场的 Cadence Tensilica 终端侧AI IP解决方案
陈会馨, Cadence公司亚太及日本地区IP与生态系统销售群总监, Cadence Design Systems, Inc.


通过硬件信任根保护供应链
Meng-Yi Wu, R&D Director, PUFsecurity

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