Design And Reuse 新闻简报
www.design-reuse-china.com
2024年09月17日

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欢迎阅读2024年09月17日的D＆R SoC新闻快讯
为您提供最新的SOC社区新闻和信息更新


新思科技40G UCIe IP
Synopsys • 方案包括控制器、PHY、验证IP
• 为AI数据中心芯片提供最大带宽
• 已集成的SI监控器以确保硅生命周期的可靠性
• 方案基于硅验证的架构
 点击了解更多 >>

铸造生态系统
关于互连
与Secure-IC相约在国际智能交通大会(ITS World Congress )及国际商用车展 (IAA)
Secure-IC
探索我们最新创新技术：
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设计
Xiphera
nQrux® Secure Boot

• 适用于计算平台的硬件级信任方案
• 抵御量子攻击的PQC+ECC混合安全加密技术
• 自研纯数字逻辑运算
 了解更多信息 >>

RISC-V
本周热门多媒体IP
Dolphin Design
 配备高低功率模式的单 DC/DC 转换器
• 确保低至 280 nA的静态电流
• 峰值电源效率高达 93%
• 输入电压高达 5.5 V - 无需额外掩模
• 在实现最小化面积的同时，可配置功率级
 即可在TSMC 22ULL 工艺中投入使用

人工智能新闻
关于安全
合作伙伴商业新闻
IP SoC 24 China 回顾

NEOX | GA100: 为 MCU量身定做的行业首款RISC-V GPGPU
Xianggang Kong, Director of Business Development, Think Silicon S.A.

高性能RISC-V及一致性总线IP解决方案
Zhiguo Ge, NoC chief architect, StarFive

在快速增长的 AI 市场中展现 RISC-V 优势
张岩, SiFive 首席现场应用工程师, Sifive, Inc.


40G UCIe PHY for high-density advanced packages
  • High-bandwidth, low-power die-to-die connectivity
  • Supports up to 40Gbps data rates, 12.9Tbps/mm capacity
  • AMBA protocols, PCI Express, CXL compatibility

IP SoC 24 China 回顾

欢迎加入 IP SoC 社区
Gabrièle Saucier, CEO, Design And Reuse

从设计到量产，大模型芯片一站式IP和定制服务平台
Louis Li, Vice President of FAE, Innosilicon

面向智能生活的一站式IP和SoC平台解决方案
李想, 项目总监, 灿芯半导体

使用硬件堆栈的优势在您的 ASIC 或 FPGA 设计中
Dr. Calliope-Louisa Sotiropoulou, Sales Engineer, CAST, Inc.

Kalray利用Tessent增强型追踪译码器优化其复杂软件性能
Yifan Li, Tessent Account Technology Manager, Siemens

嵌入式Monitor IP 在硅生命周期管理中起到的关键作用
Alex Yu, 高级技术经理, Synopsys, Inc.

通过RISC-V的虚拟化加速器实现敏捷硬件设计
許梓俊, CTO, ViShare Technology Ltd.

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