Agile Analog推出创新的数字包装模拟IP子系統

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可定制的模拟IP公司Agile Analog推出了其首个模拟子系统系列，涵盖电源管理、PVT检测和睡眠管理。这些创新的数字封装子系统允许将多个模拟IP直接放入数字设计流程中，并通过标准外设总线（如AMBA APB）连接，从而显著减少了将多个模拟IP集成到任何ASIC中所需的工作量。这些子系统看起来就像一个普通的数字IP块，具有工程师期望的标准接口，使其易于理解和处理。因此，上市时间、成本和风险都大大降低了。

www.eccn.com/, Apr. 26, 2023 – 

显著降低模拟 IP 集成工作量和成本

可定制的模拟IP公司Agile Analog推出了其首个模拟子系统系列，涵盖电源管理、PVT检测和睡眠管理。这些创新的数字封装子系统允许将多个模拟IP直接放入数字设计流程中，并通过标准外设总线（如AMBA APB）连接，从而显著减少了将多个模拟IP集成到任何ASIC中所需的工作量。这些子系统看起来就像一个普通的数字IP块，具有工程师期望的标准接口，使其易于理解和处理。因此，上市时间、成本和风险都大大降低了。最初，该公司正在推出三个子系统：用于电源管理的agilePMU，agilePVT - PVT传感器和用于睡眠管理的agileSMU。

Agile Analog产品营销总监Chris Morrison表示："我很高兴地宣布我们的前三个子系统。客户一直在寻找缩短上市时间、降低成本和减少风险的方法，而我们新的数字包装子系统正是这样做的。至关重要的是，客户不再需要处理模拟和数字之间复杂的混合信号边界，从而大大减少了他们的设计工作，并降低了通常与集成复杂模拟IP阵列相关的风险。

子系统中的IP模块全部来自Agile Analog现有的可定制模拟IP产品组合。这允许子系统中的每个模块都可以根据客户的确切要求进行定制，同时位于整个数字包装中。与所有Agile Analog IP 一样，数字封装子系统与工艺和代工无关，并且每个设计都针对客户的特定 PDK 进行了优化。在子系统中集成 IP 可消除重复的模拟功能、降低设计规则检查 （DRC） 要求并优化互连，从而进一步增强客户的设计。这些可提高抗噪性、降低功耗和减小面积。

客户的另一个关键好处是，模拟到数字、混合信号、边界的所有验证要求都由敏捷模拟执行。这大大减少了客户设计和验证时间，降低了设计过程的风险，降低了混合信号设计工具的许可成本，并简化了集成。客户现在可以添加模拟功能以提供产品差异化，而无需专业的模拟和混合信号工程师以及相关的昂贵工具链。

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