CAST 升级串行存储器控制器 IP 核，新增加密、低功耗及符合 ASIL 标准的选项

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Jul. 28, 2026 –

新泽西州伍德克利夫湖 – 2026年7月21日 –

经量产验证的 xSPI、HyperBus 和 Xccela 控制器新增 AES 加密、AMBA 功耗状态管理以及可编程延迟调节功能

半导体IP核供应商 CAST 今日宣布推出 xSPI-MC 串行存储器控制器 IP 核的增强版本，为 ASIC 和 FPGA 设计人员提供功能更强大、集成风险更低的解决方案，用于连接和访问当前多样化的外部串行存储器，并支持从这些存储器启动系统。

升级后的 xSPI-MC 内核支持 JEDEC xSPI、HyperBus™、Xccela™ 以及用于串行 NOR、串行 NAND、PSRAM 和 HyperRAM™ 器件的多种专有 SPI 存储器接口。该控制器兼容 1x、2x、4x QSPI、8x OSPI 或双四通道，以及 16x 串行存储器接口，并支持通过 XIP、AIP（在适用情况下）、DMA、引导映像复制以及寄存器驱动模式实现灵活的系统访问。

尽管 xSPI 标准有助于规范串行存储器接口，但 SoC 团队仍面临不同存储器供应商、配置文件、命令集、延迟周期、传输位宽以及 SDR/DDR 工作模式之间的实际差异。CAST 的运行时可编程协议引擎和自动配置功能有助于降低这种集成风险，特别是在项目后期存储器选择发生变更，或者单个系统必须支持多种存储器类型时。

xSPI-MC 内核的新功能包括：

• 可选的 AES-128 CTR 加密；

• 标准的 AMBA P 通道功耗状态管理（可选配 Q 通道封装）；以及

• 用于配置所有工作模式（SDR/DDR、1x–16x、高速/低速）下可编程输入延迟线的控制功能，可在运行时或初始化/校准期间动态编程。

这些特性共同帮助系统开发人员保护片外固件和数据，降低空闲和待机功耗，并改善不同存储器器件、电路板及实现工艺间的时序裕量。

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